Abstract
近年、無線センサーネットワークを始めとする低消費電力アプリケーションの要求が高まり、低消費電力動作が可能な容量DAC(Digital-to-Analog Converter)が注目を浴びている。本報告では容量DACで一般的に用いられているセグメント方式に3進数を応用した方式を提案する。この方式を用いることにより必要なキャパシタ数を削減でき、DACの高精度化・小型化・高速化が可能となる。実際に0.18μm TSMC CMOSプロセスを用いて8-bit DACのチップ試作・評価を行い、従来方式と比較して性能の向上を確認した。
Translated title of the contribution | A 8-bit segmented charge-redistributed DAC using ternary logic |
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Original language | Undefined/Unknown |
Pages (from-to) | 225-225 |
Number of pages | 1 |
Journal | 電気関係学会九州支部連合大会講演論文集 |
Volume | 2011 |
Issue number | 0 |
DOIs | |
Publication status | Published - 2011 |